Diseño de Una Memoria Cache

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Asignatura Datos del alumno Fecha

Tecnología de Apellidos: BURGOS BLANCO


Computadores Nombre:OLIVIA

Parámetros de diseño de una memoria caché

Un computador dispone de una memoria principal de 4 GB y se quiere diseñar una


memoria caché de 128 KBytes, con líneas de 32 Bytes, para aumentar el
rendimiento del sistema.

Para los siguientes supuestos:

 Memoria caché de correspondencia directa.


 Memoria caché de correspondencia asociativa.
 Memoria caché de correspondencia asociativa por 4 conjuntos.

Indica:

 Número de líneas que contiene la memoria caché.


 Tamaño de etiqueta (en bits).
 Número de líneas que hay en la memoria principal.
 El tamaño en bits de los campos en los que se divide la dirección de memoria
principal (etiqueta (k), línea o índice (j) y palabra (i)).
 Para cada uno de los tres casos propuestos, cuál o cuáles serían los valores de
etiqueta, índice y byte o palabra correspondientes a la dirección de memoria
© Universidad Internacional de La Rioja (UNIR)

principal:
1010 0110 1000 1010 1101 0111 1101 1110

Trabajo final 1
Asignatura Datos del alumno Fecha
Tecnología de Apellidos: BURGOS BLANCO
Computadores Nombre:OLIVIA

Objetivos

Demostrar habilidades adquiridas durante el curso en el manejo de la memoria del


computador.

Criterios de evaluación

El estudiante debe presentar un documento en Word en el que muestre


detalladamente la solución por escrito del ejercicio propuesto. Se valorarán las
respuestas claras y argumentadas, la presentación, los documentos bien escritos y
la buena ortografía.

Extensión máxima: 10 páginas, Calibri 11 e interlineado 1,5.


Número de líneas que contiene la memoria caché.
Tamaño de etiqueta (en bits).
Número de líneas que hay en la memoria principal.
El tamaño en bits de los campos en los que se divide la dirección de memoria principal
(etiqueta (k), línea o índice (j) y palabra (i)).
Para cada uno de los tres casos propuestos, cuál o cuáles serían los valores de etiqueta,
índice y byte o palabra correspondientes a la dirección de memoria principal:
1010 0110 1000 1010 1101 0111 1101 1110
M = 4K
C = 128 Kb
L = 32 B
Número de líneas:
Para obtener el número de líneas de la memoria cache, esto equivale a 2m y esto se obtiene
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dividiendo:
𝐶 217
𝐿
= 25
= 212 = 4096 = 4K líneas

Trabajo final 2
Asignatura Datos del alumno Fecha
Tecnología de Apellidos: BURGOS BLANCO
Computadores Nombre:OLIVIA

Bits de dirección (m): Para obtener los bits de dirección, tomamos el exponente del
resultado de número de líneas:
12 Bits

Tamaño del bloque en memoria principal:


Este debe coincidir con el número de líneas de la memoria cache
32 Bytes
Capacidad por posición:
1 Byte
Esto indica que un bloque de la memoria principal se asigna a una línea de la memoria
cache.

Número de bloques en la memoria principal:


Esto se haya dividiendo el tamaño total de la memoria dividiendo sobre el tamaño del
bloque
4G = 232
32 = 25
232
25
= 227 = 134217728 = 134M bloques

El tamaño en bits de los campos en los que se divide la dirección de memoria principal se
calcula de la siguiente manera:
El tamaño total equivale al tamaño de la línea 32 Bytes, es decir, 32 posiciones
Tamaño de la palabra: Esto equivale a los 5 primeros espacios, que corresponde al tamaño
de la línea 25
Tamaño del índice: Esto equivale a los 12 siguientes espacios, que corresponde al número
de líneas 212
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Tamaño de la etiqueta: 215 = Esto equivale a los espacios restantes, que se obtienen
restando 32 – 17 = 15

Dirección de la memoria principal:


1010 0110 1000 1010 1101 0111 1101 1110

Trabajo final 3
Asignatura Datos del alumno Fecha
Tecnología de Apellidos: BURGOS BLANCO
Computadores Nombre:OLIVIA

A58AD7DE
Basado en los tamaños de datos de palabra, índice y etiqueta, se distribuye de la siguiente
manera
10100110100010101101011111011110
© Universidad Internacional de La Rioja (UNIR)

Trabajo final 4

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