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    Datasheet 4510-4516

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    Ce document décrit les compteurs/décompteurs intégrés synchrones 4510 et 4516, y compris leur fonctionnement, leur brochage, leurs symboles logiques et leur mise en cascade.

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    DATASHEET 4510-4516

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    THÈME 3 : LOGIQUE SEQUENTIELLE

    COMPTEURS/DECOMPTEURS INTEGRES SYNCHRONES

    Compteurs/décompteurs intégrés 4510 - 4516 :


    1. Présentation :
    - 4510 : compteur/décompteur synchrone BCD.
    - 4516 : compteur/décompteur synchrone binaire.
    Le C.I 4516 est à 4 bits qui possède le même brochage que
    le CI 4510, mais il fonctionne en mode binaire.
    Les changements d'état des compteurs sont synchrones sur
    front montant de l'entrée d’hrologe CP (Clock Pulse).
    Ces circuits possèdent :
    - Une entrée de contrôle de comptage/décomptage UP/̅̅̅̅̅
    appelée encore (U/ ̅ ) ;
    Figure 1
    - une entrée de validation de comptage (̅̅̅̅̅) active au niveau BAS ;
    - une entrée de chargement parallèle (PL) asynchrone active au niveau HAUT ;
    - quatre entrées de données ou entrées de programmation (P0, P1, P2 et P3) ;
    - quatre sorties du compteur/décompteur (Q0, Q1, Q2 et Q3) ;
    - une sortie de fin de comptage (̅̅̅̅̅ : Termial Count ) ;
    - une entrée de remise à zéro prioritaire MR. (Master Reset) asynchrone.

    2. Brochages des circuits intégrés 4510 - 4516 :

    Figure 2

    1
    3. Symboles logiques des CI 4510 – 4516 :

    Figure 3
    4. Description des broches :
    désignation N° broche fonction
    PL 1 Entrée de chargement (pré-positionnement) (active au niveau HAUT)
    P0, P1, P2, P3 4,12,13,3 Entrées de données (entrées de programmation)
    ̅̅̅̅ 5 Entrée de validation (active au niveau BAS)
    CP 15 Entrée d’impulsion d’horloge (front déclenché : front montant)
    U/ ̅ 10 Entrée de contrôle (sélection) : compteur / décompteur
    MR 9 Entrée de remise à zéro prioritaire (active au niveau HAUT)
    ̅̅̅̅ Sortie de fin de cycle de comptage ou de décomptage (active au
    7
    niveau BAS)
    Q0, Q1, Q2, Q3 6,11,14,2 Sorties du compteur/décompteur
    VDD 16 Tension d’alimentation
    VSS 8 Masse (0 V)

    5. Outil de description :
    a) Table de fonctionnement des circuits intégrés 4510 - 4516

    Mode d’action MR PL ̅̅̅̅ U/ ̅ CP


    Remise à zéro (RAZ) asynchrone Q0=0, Q1=0, Q2= 0, Q3=0, 1 x x x x
    Chargement asynchrone Q0=P0 , Q1=P1 ,Q2= P2 , Q3=P3 0 1 x x x
    Inhibition (Sans changement) Qn+1 = Qn ; bloqué - non validé 0 0 1 x x
    Compteur décimal (0...9) pour le 4510
    Comptage (Incrémentation) 0 0 0 1 
    Compteur binaire (0...15) pour le 4516
    décompteur décimal (9...0) pour le 4510
    Décomptage (Décrémentation) 0 0 0 0 
    Décompteur binaire (15...0) pour le 4516

    2
    b) Chronogrammes du circuit intégré 4510

    Figure 4

    c) Chronogrammes du circuit intégré 4516

    Figure 5

    3
    6. Mise en cascade des compteurs/décompteurs intégrés 4510 - 4516 :
    L'association des compteurs en cascade est utilisée dans le but de réaliser des compteurs
    sur des cycles plus longs. Le mode d'association se déduit directement du mode de
    fonctionnement interne de chaque compteur.
    a) Cascade synchrone
    L'association des compteurs synchrones sera elle-même synchrone. Le signal d'horloge est
    unique et commun à tous les compteurs. Un compteur devra changer d'état lorsque le
    précédent sera en fin de cycle. C'est pourquoi tous les compteurs synchrones disposent
    d'un signal de sortie actif lorsque le compteur est justement en fin de son cycle. Ce signal
    sera donc connecté sur une entrée d’autorisation de comptage (validation) du compteur
    suivant.

    Figure 6

    b) Cascade asynchrone
    Il est aussi possible de réaliser pour quelques circuits intégrés une cascade asynchrone à
    partir de compteurs synchrones. C'est à dire que la sortie de fin de cycle du compteur du
    poids le plus faible sera connectée au signal d'horloge du compteur suivant. Mais ce
    montage perd l’intérêt propre du mode de fonctionnement des compteurs synchrones: on
    retrouve le retard de propagation et des valeurs incohérentes en sortie pour le travail en
    hautes fréquences.

    Figure 7

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