Ht303su PDF
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MANUAL DE SERVIÇO
RECEPTOR DVD/CD
MODELO: HT303SU-A2(SH33SU-S/W)
MANUAL DE SERVIÇO
MODELO: HT303SU-A2(SH33SU-S/W)
P/NO : AFN37064409 FEBRUARY, 2008
[ ÍNDICE ]
❍ SEÇÃO 1. GENERAL
• PRECAUÇÕES DE MANUTENÇÃO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-2
• PRECAUÇÕES ESD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-4
• INFORMAÇÕES PARA MANUTENÇÃO DE EEPROM . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-5
• COMO ATUALIZAR O PROGRAMA AUDIO MICOM & O PROGRAMA DVD . . . . . . . . . . . . . . . . . . 1-7
• ESPECIFICAÇÕES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-8
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SEÇÃO 1. GERAL
PRECAUÇÕES DE MANUTENÇÃO
NOTAS SOBRE O MANUSEIO DO CAPTADOR
1. Notas de transporte e armazenagem
1) O captador deve sempre ser mantido em sua embalagem condutiva até imediatamente antes do uso.
2) O captador jamais deve ser objeto de pressão externa ou impacto.
Pressão
Magneto
Pressão
Manta condutiva
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NOTAS SOBRE OS REPAROS NO CD PLAYER
1. Preparação
1) Os CD Players incorporam um grande número de CIs, assim como o captador (diodo laser). Esses compo-
nentes são sensíveis e facilmente afetados por eletricidade estática. Se essa eletricidade estática tiver alta
voltagem, os componentes podem ser danificados, e por este motivo os componentes devem ser manusea-
dos com cuidado.
2) O captador é composto de vários componentes ópticos e outros componentes de alta precisão. Deve-se ter
cuidado, portanto, para evitar reparo ou armazenagem onde a temperatura da umidade for alta, onde hou-
ver forte magnetismo, ou onde houver excesso de pó.
2. Notas de reparo
1) Antes de substituir um componente, desconecte primeiro o cabo de alimentação do aparelho
2) Todos os equipamentos, instrumentos de medição e ferramentas devem estar aterrados.
3) A bancada deve ser coberta com uma manta condutiva e aterrada.
Quando remover o captador laser de sua embalagem condutiva, não coloque o captador na embalagem.
(Por que há a possibilidade de dano por eletricidade estática.)
4) Para evitar escoamento elétrico, a parte metálica do ferro de solda deve estar aterrada.
5) Os trabalhadores devem estar aterrados por uma pulseira de aterramento (1MΩ)
6) Deve-se tomar cuidado para não permitir que o captador laser entre em contato com o vestuário, para evi-
tar que as cargas de eletricidade estática escapem da pulseira de aterramento.
7) O feixe de laser do captador NUNCA deve ser direcionado diretamente para os olhos ou pele.
Pulseira de aterramento
Resistor
(1 MΩ)
Resistor
Manta con-
(1 MΩ)
dutiva
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PRECAUÇÕES CONTRA ESD
Dispositivos Eletrostaticamente Sensíveis (ESD)
Alguns dispositivos semicondutores (em estado sólido) podem ser danificados facilmente pela eletricidade estáti-
ca. Esses componentes são normalmente chamados de Dispositivos Eletrostaticamente Sensíveis (ESD).
Exemplos de dispositivos ESD típicos são os circuitos integrados e alguns transistores de efeito de campo e com-
ponentes de chip semicondutores. As seguintes técnicas devem ser usadas para ajudar a reduzir a incidência de
danos a componentes causados por eletricidade estática.
1. Imediatamente antes de manusear qualquer componente semicondutor ou conjunto equipado com semicon-
dutor, libere a eletricidade estática de seu corpo tocando em um aterramento conhecido. Outra opção é usar
uma pulseira de descarga, disponível comercialmente, que deve ser removida antes de ligar o aparelho em
teste, por causa do perigo potencial de choques.
2. Após remover um conjunto elétrico equipado com dispositivos ESD, coloque o conjunto em uma superfície con-
dutiva, como uma folha de alumínio, para evitar o acúmulo de carga eletrostática ou a exposição do conjunto.
3. Use apenas um ferro de solda de ponta aterrada para aplicar ou remover solda de dispositivos ESD.
4. Use apenas dispositivos de remoção de solda anti-estáticos. Alguns dispositivos de remoção de solda, não
classificados como “antiestáticos”, podem gerar cargas elétricas suficientes para danificar dispositivos ESD.
5. Não use produtos químicos que tenham freon como propelente. Eles podem gerar cargas elétricas suficientes
para danificar dispositivos ESD.
6. Não remova um dispositivo ESD de reposição de sua embalagem protetora até imediatamente antes de estar
pronto para instalá-lo. (A maioria dos dispositivos ESD é embalada com condutores unidos eletricamente, com
circuito fechado por espuma condutiva, folha de alumínio ou materiais condutivos similares).
7. Imediatamente antes de remover o material de proteção dos condutores de um dispositivo ESD de reposição,
toque no material de proteção do chassis ou do conjunto de circuito no qual o dispositivo será instalado.
8. Minimize os movimentos do corpo quando estiver manuseando dispositivos ESD de reposição fora da embal-
agem. (Caso contrário, movimentos inofensivos como a fricção do tecido de suas roupas ou o levantar de seu
pé de um piso acarpetado podem gerar eletricidade estática suficiente para danificar um dispositivo ESD).
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INFORMAÇÕES PARA MANUTENÇÃO DE EEPROM(DVD)
LIGUE
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INFORMAÇÕES PARA MANUTENÇÃO DE EEPROM(MICOM)
LIGUE
NAME HEX
OPT 1 66
OPT 2 4A
FLD ‘OP-0….
OPT 3 21
OPT 4 27
OPT 5 00
Desligamento automático
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COMO ATUALIZAR O PROGRAMA AUDIO MICOM &
O PROGRAMA DVD
1. Como atualizar o programa AUDIO MICOM.
[Atualização com o uso do CD]
(1) Mude o nome do arquivo para baixar como “(MODEL NAME)_(Version).HEX”. Apenas são
permitidas letras com caixa alta.
ex) HT353 : “HT353_0709081.HEX”
(2) Copie o arquivo para uma pasta raiz de um CD e grave-o .
(3) Insira o CD no SET, e mova para a função DVD. Aí então, o processo de atualização irá
começar com as informações atualizadas.
(4) Quando terminar o processo de atualização o SET será religado com a mensagem
“Complete”.
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ESPECIFICAÇÕES
GERAIS
Força Elétrica Referir-se ao sêlo principal
Consumo de energia Referir-se ao sêlo principal
Peso líquido 3.6 kg
Dimensões externas (W x H x D) 430 x 70 x 311 mm
Condições de operação Temperatura: 5°C to 35°C, Condição operacional: Horizontal
Umidade operacional De 5% até 85%
AMPLIFICADOR
Modo Surround Frontal:45W + 45W ((Potência de Saída 30W, THD 10%)
(*Dependendo das configurações
do modo de som e da fonte,pode Central*:45W
ser que não haja nenhuma saída
de som ). Surround*: 45W + 45W ((Potência de Saída 30W, 4 Ωat 1 kHz, THD 10%)
Subwoofer*: 75W ((Potência de Saída 60W, 8 Ωat 30 Hz, THD 10%)
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SECTION 2. SEÇÃO DA PARTE ELÉTRICA
GUIA PARA SOLUÇÃO DE PROBLEMAS
1. CIRCUITO DE FORNECIMENTO DE ENERGIA
CONECTE O
CABO DE FORÇA
SIM
SIM
LIGUE
SIM
SIM
NAO
A LEITURA VERIFIQUE O CIRCUITO DO LASER
INICIAL FUNCIONA?
SIM
VERIFIQUE O CIRCUITO DO FOCO
VERIFIQUE O DISCO
SIM
NAO
HÁ SAÍDA DE ÁUDIO? VERIFIQUE O CIRCUITO DE ÁUDIO
SIM
OK
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2. CIRCUITO FRONTAL (1/2)
LIGUE
SIM
SIM SIM
SIM
SIM
VERIFIQUE SE
TODOS OS BOTÕES 1
ESTÃO OK
SIM
SIM
B/D FRONTAL OK
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3. FRONT CIRCUIT (2/2)
Verifique se a NAO
alimentação da frente CONSULTE SMPS
está OK
SIM
VERIFIQUE SE NAO
R345~R350
ESTÁ OK
SIM
Verifique se a NAO
alimentação da frente CONSULTE SMPS
está OK
SIM
SIM
Verifique se a NAO
voltagem em RC2
está ok (5V)
SIM
Resolde ou VERIFIQUE O
substitua RC2 CIRCUITO RM
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4. FLUXO DE OPERAÇÃO DO SISTEMA
Ligar
Mostrar LOGO
SIM SIM
Bandeja fechada?
NÃO
SIM
SLED
do lado interno?
NÃO
Receber tecla
de Abre/Fecha?
NÃO
1. Executar tecla pressionada e a tecla IR
2. Loop da rotina de operação do sistema
Receber
NÃO tecla CLOSE?
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5. FLUXO DE TESTE E DEPURAÇÃO
TESTE
SIM
Verifique a NAO
PCBA de alimentação CA (110V Verificar a alimentação
or 220V).
SIM
SIM
As NAO
saídas DC estão normais? (12V, 5.6V, Verificar a alimentação
3.5V, 5V,7V, 34V).
SIM
As saídas NAO
de 3.5V e 5V DC estão normais na PCBA Verificar os reguladores ou o diodo.
principal?
SIM
1. Verificar o clock do sistema de 27MHz.
NAO 2. Verificar os circuitos de reset do sistema.
FLASH atualizada
3. Verificar o sinal de habilitar Flash R/W.
com sucesso?
PRD, RWR.
4. Verificar o circuito relacionado com a
SIM memória FLASH.
NAO
A
Substituir a FLASH
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A
SIM
Ligar
SIM
SIM
SIM
Verificar as linhas de conexão
SDRAM opera NAO entre SDRAM (IC504) e
adequadamente? MT1389/L e se a SDRAM não
está danificada.
SIM
SIM
Verificar a conexão do Cabo
AV com o aparelho de TV
A
bandeja se NAO Sinal de NAO Verificar o interruptor de OPEN
move para dentro quando não OPEN_SW, CLOSE_SW & CLOSE de carga.
está na posição normal?
Fechada?
SIM
SIM
Sinal de
NAO Verificar os pinos IO de
TROPEN e
TRCLOSE normal? controle da bandeja em
MT1389/L.
SIM
Sinal
NAO Verificar o circuito amplificador
LOAD + e LOAD-
normal? da Bandeja IC401
SIM
Verificar a conexão do cabo
B entre o PCAB principal e o
carregador (MECHA)
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B
SIM
SIM
SIM
O pino
DRV_MUTE do driver NAO Verificar o circuito relacionado
do motor está a SLEGN
alto?
SIM
SLED+ e NAO
Verificar o circuito do AMP
SLED- tem saída
no driver do motor
adequada?
SIM
Não colocar o disco e fechar Verifique a conexão do
a bandeja cabo com MECHA
Há
A lente NAO saída de Foco NAO Verificar a conexão do Foco
óptica tem movimentos adequado para o driver em MT1389/L e no driver do
para buscar o do motor?
foco? motor
SIM
SIM
SIM
Verificar a conexão do cabo
com o cabeçote do captador.
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C
SIM
SIM
Verificar a conexão do cabo
entre o transistor de saída e o
cabeçote do captador.
NAO
Disco colocado? Laser desligado
SIM
SIM SIM
SIM
SIM
SIM
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D
SIM
SIM
SIM
Sinal
NAO Verificar o circuito relacionado
CD-DCDCT adequado
em MT1389/L. em MT1389/L CD-DVDCT.
SIM
Verificar a conexão
CD_DVDCT entre o AM5890 e
MT1389/L.
Proper
NAO NAO Verificar o circuito relacionado
Track ligado? CD-DVDCT signal
on MT1389/L. em MT1389/L.
SIM SIM
SIM
SIM
Verificar a conexão do cabo
no cabeçote do captador.
NAO
Disco toca? Verificar o sinal RF
SIM
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E
SIM
SIM
SIM
Verificar o circuito relacionado
Saída normal NAO
a PWM. (Verificar saída de
de PWM IC?(IC704). áudio, Pinos 55, 59, 61, 62, 68,
71, 75).
SIM
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6. PROTEÇÃO AMP
SIM
SIM
Ligar
SIM
"PROTECTION" NAO
Aparece continuamente no FLD. OK.
SIM
SIM
SIM
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7. CIRCUITO µ-COM DE ÁUDIO (DVD E AMPLIFICADOR)
LIGAR
SIM
Aparece Aparece
Loading NAO NAO
DVD Error
(carregando) no (erro no DVD) no
FLD? FLD?
SIM SIM
SIM SIM
Verificar NAO
se o DVD e Audio Verificar oscilador de Consultar circuito do
Micom estão oscilador
OK. X101.
SIM
SIM
SIM SIM
Verificar se NAO
Verificar Módulo DVD os Pinos 9,36 e 59 de Verificar linha 3.3V
IC101 estão
SIM altos (5V).
SIM
SIM
Substituir IC101
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DETALHES E SINAIS DO TESTE DE SISTEMA E DEPURAÇÃO
1. Sinal do sistema 27MHz clock, reset, flash R/W
1
1
FIG 1-1
4
3 2
FIG 1-2
IC501
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3) Flash R/W permite sinal durante download.
2
1
FIG 1-4
2. CLOCK DA SDRAM
1 1
FIG 2-1
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3. SINAL DE ABRE/FECHA DA BANDEJA
1
1
2
2
3 3
4 4
1
1
2
3
4 2
FIG 3-3
3
4
Direitos autorais ©2008 LG Electronics.Inc. 2-15 Apenas para uso Interno da LGE
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Apenas para efeitos de treinamento e de manutenção.
4. SINAL RELATIVO A CONTROLE SLED (CONDIÇÃO SEM DISCO)
1
2
1
3
FIG 4-1
3
4
Apenas para uso Interno da LGE 2-16 Direitos autorais ©2008 LG Electronics.Inc.
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Apenas para efeitos de treinamento e de manutenção.
5. SINAL RELATIVO A CONTROLE DE LENTE (CONDIÇÃO SEM DISCO)
2
1
FIG 5-1
3
2
1
1
2 3
2
3
FIG 6-1
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Apenas para efeitos de treinamento e de manutenção.
7. SINAIS DE RECONHECIMENTO DE TIPO DE DISCO
2
3 IC501
IC501
Apenas para uso Interno da LGE 2-18 Direitos autorais ©2008 LG Electronics.Inc.
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Apenas para efeitos de treinamento e de manutenção.
1
2
3
IC501
IC501
Direitos autorais ©2008 LG Electronics.Inc. 2-19 Apenas para uso Interno da LGE
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Apenas para efeitos de treinamento e de manutenção.
8. SINAIS DE FOCO LIGADO
2
3 1
4 IC501
2
3
2
4
4
3
Apenas para uso Interno da LGE 2-20 Direitos autorais ©2008 LG Electronics.Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
9. SINAIS DE CONTROLE DO EIXO (CONDIÇÃO SEM DISCO)
2
1
FIG 9-1
2
3
3
1
4
IC501
FIG 10-1(DVD)
Direitos autorais ©2008 LG Electronics.Inc. 2-21 Apenas para uso Interno da LGE
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
1
4 2
FIG 10-2(CD)
3
4
1
1
FIG 11-1
Apenas para uso Interno da LGE 2-22 Direitos autorais ©2008 LG Electronics.Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
2) Y
IC501
FIG 11-2
ASDATA3
1 3 2
IC501
FIG 12-1
Direitos autorais ©2008 LG Electronics.Inc. 2-23 Apenas para uso Interno da LGE
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Apenas para efeitos de treinamento e de manutenção.
13. SINAIS DE DVD E AMPLIFICADOR
1) 2)
3) 4)
5) 6)
4
3
Apenas para uso Interno da LGE 2-24 Direitos autorais ©2008 LG Electronics.Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
DIAGRAMA DE BLOCO INTERNO DOS ICs
1. IC501 MPEG(MT1389L)
• CONFIGURAÇÃO DO PIN
ADVCM / GPIO20 /
ARF / LFE / GPIO
RFH / OPINN /
RFIN / OPOUT /
RFG / OPINP /
ADACVDD2
ADACVDD1
ARS / GPIO
ADACVSS1
ADACVSS2
AR / GPIO0
ALS / GPIO
AL / GPIO1
AVDD18_1
DACVDDA
DACVDDB
DACVSSC
APLLVDD
APLLCAP
AADVDD
AADVSS
AGND18
AVCM
CVBS
RFIP
FS
G
R
B
128
127
126
125
124
123
122
121
120
119
118
117
116
115
114
113
112
111
110
109
108
107
106
105
104
103
102
101
100
99
98
97
RFA 1 96 VREF
RFB 2 95 DACVDDC
RFC 3 94 GPIO13
RFD 4 93 SPDIF / GPIO12
RFE 5 92 GPIO11
RFF 6 91 GPIO10
AVDD18_2 7 90 DVDD18
AVDD33_1 8 89 GPIO9
XTALI 9 88 GPIO8
XTALO 10 87 GPIO7 / CKE
AGND33 11 86 RA3
V20 12 85 RA2
V14 13 84 DVDD33
REXT 14 83 RA1
MDI1 15 82 RA0
MDI2
LDO1
LDO2
AVDD33_2
16
17
18
19
MT1389L 81
80
79
78
RA10
BA1
DVSS18
BA0
DMO 20 77 RAS#
FMO 21 76 CAS#
TRAY_OPEN 22 75 RWE#
TRAY_CLOSE 23 74 RA4
TRO 24 73 RA5
FOO 25 72 RA6
FG / GPIO2 26 71 RA7
USB_DP 27 70 RA8
USB_DM 28 69 RA9
VDD33_USB 29 68 DVDD33
VSS33_USB 30 67 RA11
PAD_VRT 31 66 RCLK
VDD18_USB 32 65 DQM1
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
GPIO3 / INT#
GPIO4
GPIO6
SF_CS_
SF_DO
SF_DI
SF_CK
UP1_6 / SCL
UP1_7 / SDA
ICE
PRST#
IR
RD0
RD1
RD2
RD3
RD4
DVDD33
RD5
RD6
RD7
DVDD18
DQM0
RD15
RD14
RD13
RD12
DVSS33
RD11
RD10
RD9
RD8
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1. IC501 MPEG(MT1389L)
• DIAGRAMA DE BLOCOS
DVD
Debug CVBS, Y/C
PUH Port
108MHz
Component
Module TV Encoder
Video
RF Amplifier
Video DAC
Servo IO
Motor Servo
Drive Processor Video De-
Processor interlacer
Spindle
Control
FLASH MPEG-1/2/4
ROM Audio JPEG
Memory DSP
Controller Video Decoder
Internal
6ch Audio DACs
6ch Audio Analog
DRAM
outputs
System
GPIO CPU Audio Mic1
32-bit
RISC Audio Mic2
In ternal
Audio ADC
IR/VFD
MS/SD/MMC
Card MS/SD/MMC
Controller Flash Card
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Apenas para efeitos de treinamento e de manutenção.
1. IC501 MPEG(MT1389L)
• DESCRIÇÃO DO PIN
• Abbreviations:
SR: Slew Rate
PU: Pull Up
PD: Pull Down
SMT: Schmitt Trigger
4mA~16mA: Output buffer driving strength.
Pin Main Alt. Type Description
Analog I nterface (66)
125 RFIP Analog Input AC coupled DVD RF signal input RFIP
126 RFIN OPOUT Analog Input AC coupled DVD RF signal input RFIN
127 RFG OPINP Analog Input Main beam, RF AC input path
128 RFH OPINN Analog Input Main beam, RF AC input path
1 RFA Analog Input RF main beam input A
2 RFB Analog Input RF main beam input B
3 RFC Analog Input RF main beam input C
4 RFD Analog Input RF main beam input D
5 RFE Analog Input RF sub beam input E
6 RFF Analog Input RF sub beam input E
7 AVDD18_2 Analog power Analog 1.8V power
8 AVDD33_1 Analog power Analog 3.3V power
9 XTALI Input 27MHz crystal input
10 XTALO Output 27MHz crystal output
11 AGND33 Analog Ground Analog Ground
12 V20 Analog output Reference voltage 2.0V
13 V14 Analog output Reference voltage 1.4V
Current reference input. It generates reference current for
14 REXT Analog Input RF path. Connect an external 15K resistor to this pin and
AVSS
15 MDI1 Analog Input Laser power monitor input
16 MDI2 Analog Input Laser power monitor input
17 LDO1 Analog Output Laser driver output
18 LDO2 Analog Output Laser driver output
19 AVDD33_2 Analog Power Analog 3.3V power
20 DMO Analog Output Disk motor control output. PWM output
21 FMO Analog Output Feed motor control. PWM output
22 TRAY_OPEN Analog Output Tray PWM output/Tray open output
23 TRAY_CLOSE Analog Output Tray PWM output/Tray close output
Tracking servo output. PDM output of tracking servo
24 TRO Analog Output
compensator
Focus servo output. PDM output of focus servo
25 FOO Analog Output
compensator
1) Motor Hall sensor input
26 FG GPIO2 Analog
2) GPIO
27 USB_DP Analog Input USB port DPLUS analog pin
28 USB_DM Analog Input USB port DMINUS analog pin
29 VDD33_USB USB Power USB Power pin 3.3V
30 VSS33_USB USB Ground USB ground pin
31 PAD_VRT Analog Inout USB generating reference current
32 VDD18_USB USB Power USB Power pin 1.8V
95 DACVDDC Power Power
96 VREF Analog Bandgap reference voltage
97 FS Analog Full scale adjustment (suggest to use 560 ohm)
98 DACVSSC Ground Ground pin for video DAC circuitry
99 CVBS Analog Analog composite output
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Pin Main Alt. Type Description
100 DACVDDB Power 3.3V power pin for video DAC circuitry
101 DACVDDA Power 3.3V power pin for video DAC circuitry
102 Y/G Analog Green, Y, SY, or CVBS
103 B/CB/PB Analog Blue, CB/PB, or SC
104 R/CR/PR Analog Red, CR/PR, CVBS, or SY
105 AADVSS Ground Ground pin for 2ch audio ADC circuitry
` 1) Audio ADC input 2
2) MS_CLK set B
3) MCDATA
106 AKIN2 Analog 4) Audio Mute
5) HSYN/VSYN output
6) C5
7) GPIO
1) 2ch audio ADC reference voltageC
107 ADVCM Analog 2) C6
3) GPIO
1) Audio ADC input 1
2) MS_D0 set B
3) Audio Mute
108 AKIN1 Analog
4) HSYN/VSYN output
5) C7
6) GPIO
109 AADVDD Power 3.3V power pin for 2ch audio ADC circuitry
110 APLLVDD3 Power 3.3V Power pin for audio clock circuitry
111 APLLCAP Analog InOut APLL external capacitance connection
112 ADACVSS2 Ground Ground pin for audio DAC circuitry
113 ADACVSS1 Ground Ground pin for audio DAC circuitry
1) Audio DAC sub-woofer channel output
2) While internal audio DAC not used:
114 ARF / LFE GPIO Analog Output
a. ACLK
b. GPIO
1) Audio DAC right Surround channel output
115 ARS GPIO Analog Output 2) While internal audio DAC not used:
a. ABCK
b. GPIO
1) Audio DAC right channel output
2) While internal audio DAC not used:
116 AR Analog Output a. SDATA2
b. GPIO
c. RXD2
117 AV CM Analog Audio DAC reference voltage
1) Audio DAC left channel output
2) While internal audio DAC not used:
118 AL GPIO Analog Output a. SDATA1
b. GPIO
c. RXD1
1) Audio DAC left Surround channel output
119 ALS GPIO Analog Output 2) While internal audio DAC not used:
a. ALRCK
b. GPIO
1) Audio DAC center channel output
2) While internal audio DAC not used:
120 ALF /CENTER GPIO Analog Output
a. ASDATA0
b. GPIO
121 ADACVDD1 Analog Power 3.3V power pin for audio DAC circuitry
122 ADACVDD2 Analog Power 3.3V power pin for audio DAC circuitry
123 AVDD18_1 Analog Power Analog 1.8V power
124 AGND18 Analog Ground Analog Ground
General Power/ Ground (7)
54, 90 DVDD18 Power 1.8V power pin for internal digital circuitry
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Pin Main Alt. Type Description
79 DVSS18 Ground 1.8V Ground pin for internal digital circuitry
50, 68,84 DVDD33 Power 3.3V power pin for internal digital circuitry
60 DVSS Ground 3.3V Ground pin for internal digital circuitry
Micro Controller , Flash I nterface and GPIO(12)
InOut 1) General purpose IO 3
33 GPIO3 INT# 8mA, SR 2) Microcontroller external interrupt 1
PD, SMT
InOut
34 GPIO4 General purpose IO 4
4mA, PD
InOut
35 GPIO6 General purpose IO 6
4mA, PD
InOut
36 SF_CS_ 8mA, SR Serial Flash Chip Select
PU, SMT
InOut
37 SF_DO 8mA, SR Serial Flash Dout
PD, SMT
InOut
38 SF_DI 8mA, SR Serial Flash Din
PU, SMT
InOut
39 SF_CK 8mA, SR Serial Flash Clock
PD, SMT
InOut 1) Microcontroller port 1-6
40 UP1_6 SCL 8mA, SR 2) I2C clock pin
PU, SMT
InOut 1) Microcontroller port 1-7
41 UP1_7 SDA 4mA, SR 2) I2C data pin
PU, SMT
Input
42 ICE Microcontroller ICE mode enable
PD, SMT
Input
43 PRST# Power on reset input, active low
PU, SMT
Input
44 IR IR control signal input
SMT
Dram Interface (37) (Sorted by position)
InOut
45 RD0 DRAM data 0
4mA
InOut
46 RD1 DRAM data 1
4mA
InOut
47 RD2 DRAM data 2
4mA
InOut
48 RD3 DRAM data 3
4mA
InOut
49 RD4 DRAM data 4
4mA
InOut
51 RD5 DRAM data 5
4mA
InOut
52 RD6 DRAM data 6
4mA
InOut
53 RD7 DRAM data 7
4mA
InOut
55 DQM0 Data mask 0
4mA, PD
InOut
56 RD15 DRAM data 15
4mA
InOut
57 RD14 DRAM data 14
4mA
InOut
58 RD13 DRAM data 13
4mA
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Pin Main Alt. Type Description
InOut
59 RD12 DRAM data 12
4mA
InOut
61 RD11 DRAM data 11
4mA
InOut
62 RD10 DRAM data 10
4mA
InOut
63 RD9 DRAM data 9
4mA
InOut
64 RD8 DRAM data 8
4mA
InOut
65 DQM1 Data mask 1
4mA, PD
InOut
66 RCLK Dram clock
4mA, PD
InOut
67 RA11 DRAM address bit 11
4mA, PD
InOut
69 RA9 DRAM address 9
4mA, PD
InOut
70 RA8 DRAM address 8
4mA, PD
InOut
71 RA7 DRAM address 7
4mA, PD
InOut
72 RA6 DRAM address 6
4mA, PD
InOut
73 RA5 DRAM address 5
4mA, PD
InOut
74 RA4 DRAM address 4
4mA, PD
Output
75 RWE# DRAM Write enable, active low
4mA, PD
Output
76 CAS# DRAM column address strobe, active low
4mA, PD
Output
77 RAS# DRAM row address strobe, active low
4mA, PD
InOut
78 BA0 DRAM bank address 0
4mA, PD
InOut
80 BA1 DRAM bank address 1
4mA, PD
InOut
81 RA10 DRAM address 10
4mA, PD
InOut
82 RA0 DRAM address 0
4mA, PD
InOut
83 RA1 DRAM address 1
4mA, PD
InOut
85 RA2 DRAM address 2
4mA, PD
InOut
86 RA3 DRAM address 3
4mA, PD
1) GPIO 7
2) Dram Clock Enable
InOut 3) MS_CLK set A
87 GPIO7 CKE
4mA, PD 4) Audio Mute
5) HSYN/VSYN input
6) C0
GPIO (6)
1) GPIO8
2) MS_BS set A
88 GPIO8 InOut 3) SD_CLK set A
4mA, PD 4) ASDATA2
5) ACLK
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Pin Main Alt. Type Description
6) Audio Mute
7) HSYN/VSYN input
8) C1
1) GPIO9
2) MS_D0 set A
InOut 3) SD_CMD set A
89 GPIO9
4mA, PD 4) ASDATA1
5) ABCK
6) C2
7) RXD1
1) GPIO10
2) SD_CLK set B
3) SD_D0 set A
InOut 4) ASDATA0
91 GPIO10
4mA, PD 5) ALRCK
6) HSYN/VSYN output
7) C3
8) TXD1
1) GPIO11
2) SD_CMD set B
InOut 3) MS_BS set B
92 GPIO11 4mA, PD 4) Audio Mute
5) HSYN/VSYN output
6) C4
InOut 1) SPDIF output
93 SPDIF GPIO12
2mA, PD 2) GPIO12
1) GPIO13
InOut 2) SD_D0 set B
94 GPIO13 4mA, PD 3) ALRCK
4) Audio Mute
5) YUVCLK
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2. IC401 MOTOR DRIVER
• CONFIGURAÇÃO DO PIN
• DIAGRAMA DE BLOCOS
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1. IC501 MPEG(MT1389L)
• DESCRIÇÃO DO PIN
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3. IC101 MICOM1389L)
• CONFIGURAÇÃO DO PIN
PC5/DBGP0
PC7/DBGP2
PC6DBGP1
P83/AN3
P84/AN4
P85/AN5
P86/AN6
VDD3
VSS3
PC0
PC1
PC2
PC3
PC4
P30
P31
48 47 46 45 44 43 42 41 40 39 38 37 36 35 34 33
P70/INT0/T0LCP/AN8 49 32 P32/UTX1
P71/INT1/T0HCP/AN9 50 31 P33/URX1
P72/INT2/T0IN/NKIN 51 30 P34/UTX2
P73/INT3/T0IN 52 29 P35/URX2
RES 53 28 P36
XT1/AN10 54 27 P37
XT2/AN11 55 26 P27/INT5/T1IN
VSS1 56 25 P26/INT5/T1IN
LC87F5M64A
CF1 57 24 P25/INT5/T1IN
CF2 58 23 P24/INT5/T1IN/INT7
VDD1 59 22 P23INT4/T1IN
P80/AN0 60 21 P22/INT4/T1IN
P81/AN1 61 20 P21/INT4/T1IN
P82/AN2 62 19 P20/INT4/T1IN/INT6
P10/SO0 63 18 P07/T7O
P11/SI0/SB0 64 17 P06/T6O
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16
P17/T1PWMH/BUZ
P05/CKO
P12/SCK0
P14/SI1/SB1
P15/SCK1
P16/T1PWML
P13/SO1
PWM2
PWM3
VDD2
VSS2
P00
P01
P02
P03
P04
Top view
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• DIAGRAMA DE BLOCOS
Interrupt control
IR PLA
Standby control
ROM correct
CF Flash ROM
generator
RC
Clock
X’tal
MRC
PC
Timer 4 Port 7
ALU
Timer 5 Port 8
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3. IC101 MICOM
• DESCRIÇÃO DO PIN
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Pin Name I/O Description Option
Port 7 I/O • 4-bit I/O port No
P70 to P73 • I/O specifiable in 1-bit units
• Pull-up resistor can be turned on and off in 1-bit units
• Shared pins
P70 : INT0 input/HOLD reset input/timer 0L capture input/watchdog timer output
P71 : INT1 input/HOLD reset input/timer 0H capture input
P72 : INT2 input/HOLD reset input/timer 0 event input/timer 0L capture input/
high speed clock counter input
P73 : INT3 input (with noise filter)/timer 0 event input/timer 0H capture input
AD converter input port: AN8 (P70), AN9 (P71)
• Interrupt acknowledge type
Rising/
Rising Falling H level L level
Falling
INT0 enable enable disable enable enable
INT1 enable enable disable enable enable
INT2 enable enable enable disable disable
INT3 enable enable enable disable disable
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4. IC201 ADC(CS5345)
• CONFIGURAÇÃO DO PIN
SDOUT
DGND
MCLK
LRCK
OVFL
SCLK
TSTI
INT
NC
NC
NC
VD
48 47 46 45 44 43 42 41 40 39 38 37
SDA/CDOUT 1 36 VLS
SCL/CCLK 2 35 TSTO
AD0/CS 3 34 NC
AD1/CDIN 4 33 NC
VLC 5 32 AGND
RESET 6 CS5345 31 AGND
AIN3A 7 30 VA
AIN3B 8 29 PGAOUTB
AIN2A 9 28 PGAOUTA
AIN2B 10 27 AIN6B
AIN1A 11 26 AIN6A
AIN1B 12 25 MICBIAS
13 14 15 16 17 18 19 20 21 22 23 24
FILT+
VQ
TSTO
TSTO
AIN5A
AIN5B
AGND
VA
AIN4A/MICIN1
AIN4B/MICIN2
AFILTA
AFILTB
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4. IC201 ADC(CS5345)
• DIAGRAMA DE BLOCOS
VD VA VA
+1.8V 3.3 µF
to +5V VLS PGAOUTA
0.1 µF
3.3 µF
PGAOUTB
MCLK
SDOUT
* 10 µF 100 k
1800 pF 100
AIN1B Right Analog Input 1
INT
AIN2A Left Analog Input 2
OVFL 1800 pF * 10 µF 100 100 k
RESET
Micro- * 10 µF 100 k
Controller SCL/CCLK 1800 pF 100
AIN2B Right Analog Input 2
SDA/CDOUT
AD1/CDIN AIN3A Left Analog Input 3
1800 pF * 10 µF 100 100 k
AD0/CS
* 10 µF 100 k
1800 pF 100
2k 2k AIN3B Right Analog Input 3
See Note 1
+1.8V AIN4A/MICIN1 Left Analog Input 4
VLC
to +5V 1800 pF * 10 µF 100 100 k
0.1 µF
* 10 µF 100 k
1800 pF 100
AIN4B/MICIN2 Right Analog Input 4
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• DESCRIÇÃO DO PIN
Pin Name # Pin Description
Serial ControlData (Input/Output) - SDA is a data I/O in IC ® Mode. CDOUT is the output data line for
SDA/CDOUT 1
the control port interface in SPITM Mode.
SCL/CCLK 2 Serial Control Port Clock (Input) - Serial clock for the serial control port.
Address Bit 0 (IC) / Co ntrol Port Chip Select (SPI) (Input) - AD0 is a chip address pin in IC Mode;
AD0/CS 3
CS is the chip-select signal for SPI format.
Address Bit 1 (IC) / Ser ial Control Data Input (SPI) (Input) - AD1 is a chip address pin in IC Mode;
AD1/CDIN 4
CDIN is the input data line for the control port interface in SPI Mode.
ControlPort Power (Input) - Determines the required signal level for the control port interface. Refer
VLC 5
to the Recommended Operating Conditions for appropriate voltages.
RESET 6 Reset (Input) - The device enters a low-power mode when this pin is driven low.
AIN3A 7 Stereo Analog Input 3 (Input) - The full-scale level is specified in the ADC Analog Characteristics
AIN3B 8 specification table.
AIN2A 9 Stereo Analog Input 2 (Input) - The full-scale level is specified in the ADC Analog Characteristics
AIN2B 10 specification table.
AIN1A 11 Stereo Analog Input 1 (Input) - The full-scale level is specified in the ADC Analog Characteristics
AIN1B 12 specification table.
AGND 13 Analog Ground (Input) - Ground reference for the internal analog section.
VA 14 Analog Power (Input) - Positive power for the internal analog section.
AFILTA 15 Antialias Filter Connection (Output) - Antialias filter connection for the channel A ADC input.
AFILTB 16 Antialias Filter Connection (Output) - Antialias filter connection for the channel B ADC input.
VQ 17 Quiescent Voltage (Output) - Filter connection for the internal quiescent reference voltage.
TSTO 18 Test Pin (Output) - This pin must be left unconnected.
FILT+ 19 Positive Voltage Reference (Output) - Positive reference voltage for the internal sampling circuits.
TSTO 20 Test Pin - This pin must be left unconnected.
AIN4A/MICIN1 21 Stereo Analog Input 4 / MicrophoneInput 1 & 2 (Input) - The full-scale level is specified in the ADC
AIN4B/MICIN2 22 Analog Characteristics specification table.
AIN5A 23 Stereo Analog Input 5 (Input) - The full-scale level is specified in the ADC Analog Characteristics
AIN5B 24 specification table.
MicrophoneBias Supply (Output) - Low-noise bias supply for external microphone. Electrical charac-
MICBIAS 25
teristics are specified in the DC Electrical Characteristics specification table.
AIN6A 26 Stereo Analog Input 6 (Input) - The full-scale level is specified in the ADC Analog Characteristics
AIN6B 27 specification table.
PGAOUTA 28 PGA Analog AudioOutput(Output) - Either an analog output from the PGA block or high impedance.
PGAOUTB 29
VA 30 Analog Power (Input) - Positive power for the internal analog section.
31
AGND Analog Ground (Input) - Ground reference for the internal analog section.
32
33 No Connect - These pins are not connected internally and should be tied to ground to minimize any
NC
34 potential coupling effects.
TSTO 35 Test Pin (Output) - This pin must be left unconnected.
Serial Audio Interface Power (Input) - Determines the required signal level for the serial audio inter-
VLS 36
face. Refer to the Recommended Operating Conditions for appropriate voltages.
TSTI 37 Test Pin (Input) - This pin must be connected to ground.
38,
No Connect - These pins are not connected internally and should be tied to ground to minimize any
NC 39,
potential coupling effects.
40
SDOUT 41 Serial Audio Data Output (Output) - Output for two’s complement serial audio data.
SCLK 42 Serial Clock (Input/Output) - Serial clock for the serial audio interface.
Left Right Clock (Input/Output) - Determines which channel, Left or Right, is currently active on the
LRCK 43
serial audio data line.
MCLK 44 Master Clock (Input/Output) - Clock source for the ADC’s delta-sigma modulators.
DGND 45 Digital Ground (Input) - Ground reference for the internal digital section.
VD 46 Digital Power (Input) - Positive power for the internal digital section.
INT 47 Interrupt (Output) - Indicates an interrupt condition has occurred.
OVFL 48 Overflow (Output) - Indicates an ADC overflow condition is present.
Apenas para uso Interno da LGE 2-40 Direitos autorais ©2008 LG Electronics.Inc.
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5. IC704 PWM
• CONFIGURAÇÃO DO PIN
PWM8_M
PWM7_M
PWM6_M
PWM5_M
PWM4_M
PWM3_M
PWM2_M
PWM8_P
PWM7_P
PWM6_P
PWM5_P
PWM4_P
PWM3_P
PWM2_P
IO_VDD
IO_VDD
IO_VDD
IO_VSS
IO_VSS
IO_VSS
IO_VSS
IO_VSS
IO_VSS
DVDD
DVSS
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
OVERLOAD 76 50 IO_VSS
EPD_ENA 77 49 PWM1_P
SO/SDA 78 48 PWM1_M
SCK/SCL 79 47 IO_VDD
DVDD 80 46 PWM_HP_L_P
DVSS 81 45 PWM_HP_L_M
SI/I2C_AD0 82 44 IO_VSS
/CS/I2C_AD2
SPI/I2C
IO_VSS
XIN
83
84
85
86
PULSUS 43
42
41
40
DVSS
DVDD
PWM_HP_R_P
PWM_HP_R_M
XOUT 87 39 IO_VDD
DMIX_LRCK 88 38 IO_VSS
DMIX_BCK 89 37 PWM_SWL_P
DMIX_SDOUT 90 36 PWM_SWL_M
DVDD 91 35 DVSS
DVSS 92 34 DVDD
DMIX_MCLK 93 33 MIC_SDIN
IO_VDD 94 32 MIC_LRCK
IO_VSS 95 31 MIC_BCK
/RESET 96 30 MIC_MCLK
TEST_MODE1 97 29 IO_VDD
TEST_MODE2 98 28 IO_VSS
SCAN_ENA 99 27 EXT_MUTE
TEST_MODE3 100 26 SSDIN3
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
1
2
3
4
5
6
7
8
9
MSDIN0
MSDIN1
MSDIN2
MSDIN3
PLL_AVSS
DVSS
SSDIN0
SSDIN1
SSDIN2
PLL_DVSS
IO_VSS
PLL_AVDD
IO_VSS
IO_VSS
MLRCK
SBCK
SLRCK
IO_VSS
IO_VDD
MBCK
DVDD
IO_VDD
IO_VDD
PLL_DVDD
IO_VSS
• DIAGRAMA DE BLOCOS
MBCK
MLRCK Input
MSDIN[0:3] Serial Audio
&
Output
Output
SBCK interface
MUX
SLRCK
SSDIN[0:3]
Serial DMIX_MCLK
Down Audio OLRCK
Sample OBCK
Mixer Output
Rate interface DMIX_SDOUT
Converter
Automatic
Gain PWM1_P/M
Limiter
Input PWM2_P/M
Mapper
Output Mapper
PWM3_P/M
PWM4_P/M
Bass Main Trim
Mixer EQ PWM5_P/M
MIC_MCLK Manager Volume Volume
Mic. PWM6_P/M
MIC_BCK
Input
MIC_LRCK PWM7_P/M
Processor
MIC_SDIN PWM PWM8_P/M
Modulator
Internal Clock Internal Reset PWM_HP_L_P/M
SPI/I2C
SO/SDA PWM_HP_R_P/M
SCK/SCL Host
Internal Controls Reset & Power Down
SI/I2C_AD0 Interface PWM_SWL_P/M
/CS/I2C_AD2 (I2C, SPI)
POP EPD_ENA
EXT_MUTE Crystal Power Supply
PLL NR
Oscillator OVERLOAD
XI N
XOUT
/RESET
PLL_DVDD
PLL_AVDD
PLL_DVSS
PLL_AVSS
IO_VDD
IO_VSS
DVDD
DVSS
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5. IC704 PWM
• DESCRIÇÃO DO PIN
Apenas para uso Interno da LGE 2-42 Direitos autorais ©2008 LG Electronics.Inc.
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Apenas para efeitos de treinamento e de manutenção.
MIC_MCLK 30 O Main clock for external microphone input A/DC.
Clock frequency can be selected between 6.144MHz,
12.288MHz, and 24.576MHz.
MIC_BCK 31 I/O PCM bit clock input/output of external microphone.
Bit clock frequency is 3.072MHz (48kHz x 64, fixed)
MIC_LRCK 32 I/O PCM Word clock (left-right clock) input/output of external
microphone. Word clock rate is 48kHz (fixed).
MIC_SDIN 33 I PCM serial data input of external microphone.
Schmitt-Trigger input.
DMIX_MCLK 93 O Main clock for external down-mix line output D/AC.
DMIX_BCK 89 O PCM bit clock output of down-mix signal.
Bit clock frequency is 6.144MHz (96kHz x 64, fixed)
DMIX_LRCK 88 O PCM Word clock (left-right clock) output of down-mix signal.
Word clock rate is 96kHz (fixed).
DMIX_SDOUT 90 O PCM serial data output of down-mix signal.
Direitos autorais ©2008 LG Electronics.Inc. 2-43 Apenas para uso Interno da LGE
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Apenas para efeitos de treinamento e de manutenção.
SCK/SCL 79 I SCK for SPI mode or SCL for I2C mode.
Schmitt-Trigger input.
SI/I2C_AD0 82 I SI for SPI mode or Slave Address 0 for I2C mode.
Schmitt-Trigger input.
Internal pull-down resistor.
/CS/I2C_AD2 83 I Chip selector (CS) for SPI mode or Slave Address 2 for I2C
mode.
Schmitt-Trigger input.
Internal pull-down resistor.
Special Control Interface
EXT_MUTE 27 I External mute control input. Active High.
Assert ‘HIGH’ to mute audio output.
Internal pull-down resistor.
OVERLOAD 76 I Power stage overload indication input.
Polarity is programmable. Schmitt-Trigger input.
When OVERLOAD is asserted, all PWM audio outputs go to
“LOW”. That shutdown process is programmable.
Internal pull-down resistor.
EPD_ENA 77 O External amplifier power device enable output. Active High.
Test Mode
TEST_MODE1 97 I Test mode selection pin 1.
In normal operation, it should be “LOW” or not connected.
Internal pull-down resistor.
TEST_MODE2 98 I Test mode selection pin 2.
In normal operation, it should be “LOW” or not connected.
Internal pull-down resistor.
SCAN_ENA 99 I Scan enable. Active High.
In normal operation, it should be “LOW” or not connected.
Internal pull-down resistor.
TEST_MODE3 100 I Test mode selection pin 3.
In normal operation, it should be “LOW” or not connected.
Internal pull-down resistor.
All inputs and bi-directional inputs are 5 Volt tolerant. The corresponding pins can be connected to the buses that can
swing between 0V and 5V. The output-only pins are not 5V tolerant and the buses they are connected to can swing only
between 0V and 3.3V.
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DIAGRAMA DE FIAÇÃO
CABLE1
PN202
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DIAGRAMA DE BLOCOS
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DIAGRAMAS DE CIRCUITO
1. DIAGRAMA DE CIRCUITO SMPS (PRINCIPAL)
AVISO IMPORTANTE DE SEGURANÇA COMPONENTES ESPECIAIS ESTÃO SOMBREADOS ATENÇÃO:
QUANDO ESTIVER PRESTANDO MANUTENÇÃO NO ESQUEMA PARA FÁCIL IDENTIFICAÇÃO ESTE 1.Peças( )sombreadas são essenciais para segu-
NESTE CHASSI,SOB NENHUMA CIRCUNSTÂNCIA O DIAGRAMA DE CIRCUITO PODE OCASIONALMENTE rança.Reponha apenas com número específico de
DESIGN ORIGINAL DEVERÁ SER MODIFICADO OU DIFERIR DO CIRCUITO USADO DE FATO.DESSA peça.
ALTERADO SEM A PERMISSÃO DA LG ELECTRON- FORMA,A IMPLEMENTAÇÃO DAS ÚLTIMAS 2.As voltagens são medidas por corrente direta com
ICS CORPORATION.TODOS OS COMPONENTES MUDANÇAS DE MELHORIA PARA SEGURANÇA E voltímetro digital durante o modo Play.
DEVERÃO SER SUBSTITUÍDOS SOMENTE POR PERFORMANCE DENTRO DO SISTEMA NÃO ESTÁ
12 TIPOS IDÊNTICOS ÀQUELES NO CIRCUITO ORIGI- DEFASADA ATÉ QUE A NOVA LITERATURA DE
NAL.OS COMPONENTES ESPECIAIS ESTÃO SOM- SERVIÇO SEJA IMPRESSA.
BREADOS NO CIRCUITO ELÉTRICO PARA FACILI-
TAR A IDENTIFICAÇÃO.
11
10
1
NOTE) Warning
NOTE) Parts that are shaded are critical
NOTE)
NOTE)
With respect to risk of fire or
electricial shock.
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A B C D E F G H I J K L M N O P Q R S T
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2. DIAGRAMA DO CIRCUITO MPEG
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3. DIAGRAMA DO CIRCUITO SERVO
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4. DIAGRAMA DO CIRCUITO MICOM
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5. DIAGRAMA DO CIRCUITO DE E/S
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6. DIAGRAMA DO CIRCUITO AMP
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7. DIAGRAMA DO CIRCUITO MIC
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8. DIAGRAMA DO CIRCUITO FRONTAL
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9. DIAGRAMA DO CIRCUITO PWR TECLAS
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10. DIAGRAMA DO CIRCUITO DO MIC &USB &PTB
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DIAGRAMAS DAS PLACAS DE CIRCUITO IMPRESSO
1. DIAGRAMA DA PLACA PRINCIPAL P.C.(VISTA SUPERIOR)
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DIAGRAMA DA PLACA PRINCIPAL P.C.(VISTA INFERIOR)
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2. DIAGRAMA DA PLACA SMPS P.C.
NOTAS) Aviso
Partes em cinza são críticas com respeito
ao risco de incêndio ou choque elétrico.
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3. DIAGRAMA DA PLACA DE TIMER P.C. (HT303) DIAGRAMA DA PLACA DE TIMER P.C. (HT353)
4. DIAGRAMA DA PLACA DE TECLAS P.C. (HT303) DIAGRAMA DA PLACA DE TECLAS P.C. (HT353)
Apenas para uso Interno da LGE 2-75 2-76 Direitos autorais ©2008 LG Electronics.Inc.
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SECTION 3. VISTAS EXPLODIDAS
NOTAS)
NOTES)O PONTO DE EXCLAMAÇÃO
THE EXCLAMATION POINT DENTRO
WITHIN DE
AN
UM TRIÂNGULO
EQUILATERALEQÜILÁTERO
TRIANGLE ISSERVE
INTENDED
462 TOALERTAR
PARA ALERT THE SERVICE TÉCNICO
O PESSOAL PERSONNEL
• SEÇÃO DO GABINETE E ESTRUTURA CENTRAL TO THE
SOBRE
SEGURANÇA
PRESENCE
A PRESENÇA OFINSTRUÇÕES
DE
SAFETY INFORMATION
IMPORTANTES
IMPORTANT DE
INNA
SERVICE
LITER-
LITERATURE.
ATURA DE MANUTENÇÃO.
463
A 250
283
A
A50
B
452 463
463
A43
C
462
PN302 CABLE1
A47
MA
IN
E
SM
PS D C
D
275
279
FR
ON A44
A41 T
JA
CK
262
261
260 261
Direitos autorais ©2008 LG Electronics.Inc. 3-1 3-2 Apenas para uso Interno da LGE
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
• VISTA EXPLODIDA DO MECANISMO DO DECK(DP-12TV)
001
439 003
018
013
014
020
017
435
016
015B
015
015A
440
026
010
442
012A
012
A03
012 442
019
Apenas para uso Interno da LGE 3-3 3-4 Direitos autorais ©2008 LG Electronics.Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
• SEÇÃO DE ACESSÓRIOS
811 CABO DE RCA PARA VIDEO(1 VIA) 818 CABO PORTATIL DA ENTRADA
804 ADAPTADOR CA
803 EMBALAGEM, CARCAÇA
802 CAIXA
Direitos autorais ©2008 LG Electronics.Inc. 3-5 Apenas para uso Interno da LGE
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
• ALTO-FALANTE
1. ALTO-FALANTE FRONTAL/CENTRAL/TRASEIRO(SH33SU-S)
850
Apenas para uso Interno da LGE 3-6 Direitos autorais ©2008 LG Electronics.Inc.
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2. SUBWOOFER PASSIVO(SH33SU-W)
A90
952
WIRE90
950 956
954
951 955
953
Direitos autorais ©2008 LG Electronics.Inc. 3-7 Apenas para uso Interno da LGE
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Apenas para efeitos de treinamento e de manutenção.
ANOTAÇÕES
Apenas para uso Interno da LGE 3-8 Direitos autorais ©2008 LG Electronics.Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e de manutenção.
SEÇÃO 4. MECANISMO (DP-12TV)
[ ÍNDICE ]
VISTA EXPLODIDA
1. MECANISMO DO DECK VISTA EXPLODIDA (DP-12TV) . . . . . . . . . . . . . . . . . . . . . . . 4-6
Direitos de cópia © 2008 LG Electronics. Inc. 4-1 Para uso interno da LGE
Todos os direitos reservados.
Apenas para efeitos de treinamento e propósitos de serviços.
LOCALIZANDO PEÇAS DO MECANISMO DO DECK
• VISTA DO ALTO Procedure Disass Fig-
Parts Fixing Type
Starting No. embly ure
• VISTA DE BAIXO
Note
Quando remontar, faça o procedimento em orden
inversa. O “Baixo” (Bottom) no na coluna Desmonte
da tabela acima indica qual a peça que deverá ser
desmontada no lado de Baixo.
Para uso interno da LGE 4-2 Direitos de cópia © 2008 LG Electronics. Inc.
Todos os direitos reservados.
Apenas para efeitos de treinamento e propósitos de serviços.
DESMONTE DO MECANISMO DO DECK
TRAY DISC
MAIN BASE
MAGNET CLAMP
CLAMP UPPER
LEVER
BASE MAIN
BASE MAIN
Direitos de cópia © 2008 LG Electronics. Inc. 4-3 Para uso interno da LGE
Todos os direitos reservados.
Apenas para efeitos de treinamento e propósitos de serviços.
RUBBER DAMPER
Distinguish upper and
lower sides
(Assemble with care)
RUBBER DAMPER
Distinguish upper and
RUBBER DAMPER lower sides
(Assemble with care)
BASE PU
(S2)
(S2)
RUBBER DAMPER
GEAR RACK
Fig. 4-3
Para uso interno da LGE 4-4 Direitos de cópia © 2008 LG Electronics. Inc.
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GUIDE UP/DOWN
GEAR LOADING
GEAR PULLEY
(L6)
BELT LOADING
(H1)
(C2)
PWB ASSEMBLY LOADING
(S5)
(S4)
BASE MAIN
(S4)
(A) (A)
GUIDE UP/DOWN
FIG. (C)
Fig. 4-4
001
439 003
018
013
014
020
017
435
016
015B
015
015A
440
026
010
442
012A
012
A03
012 442
019
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