Réseaux pré-diffusés programmables par l’utilisateur: FPGA

Sujets de ce thème

• Structure interne d'un FPGA et composantes

principales
Technologies de circuits intégrés à application spécifique (ASIC)
• Le bloc de logique programmable d'un FPGA
Logique fixe Logique programmable
• Composantes secondaires présentes dans un Mémoire morte
FPGA. Programmable Read Only Memory – PROM
Electrically Programmable ROM – EPROM
• Programmer un FPGA. Erasable EPROM – EEPROM
ASIC sur mesure Réseau de logique programmable
Full-custom ASIC Programmable Logic Array - PLA
ASIC à cellules normalisées Circuit PAL
Cell-based ASIC Programmable Array Logic™ - PAL
Réseau pré-diffusé de portes Circuit GAL
Gate Array Generic Array Logic™ - GAL
Circuit logique programmable complexe
Complex Programmable Logic Device – CPLD
Réseau prédiffusé programmable par l’utilisateur
Field-Programmable Gate Array – FPGA

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Réseau pré-diffusé programmable par l’utilisateur
Field-Programmable Gate Array (FPGA): vue d’ensemble

• Un FPGA est un circuit intégré programmable par

l’utilisateur.
• Les premiers FPGA ont été proposés au début des
années 1980. Aujourd’hui, ils sont parmi les
circuits intégrés les plus complexes en nombre de
transistors.
• Deux manufacturiers américains de FPGA se CC by 3.0 Wikipedia/Altera

partagent la plupart du marché: Altera et Xilinx.

Altera a été achetée par Intel en 2015.
• Il existe plusieurs familles de FPGA, avec plusieurs
modèles dans chaque famille.

CC by 3.0 Wikipedia/Dake

3
Exemple de planchette de développement
La Nexys4 DDR de Digilent équipée d’un FPGA Artix-7 de Xilinx LA DE2 ALTERA

Plusieurs interfaces sur la carte, dont:

• 16 commutateurs et 16 LED
• 5 boutons-pressoirs
• Deux groupes de 4 affichages à 7 segments
• Deux LED à trois couleurs

• Sortie audio PWM

• Sortie VGA
• Ethernet 10/100
• Port USB
• Connecteur Micro SD
• Microphone PDM

• Accéléromètre à 3 axes
• Senseur de température
Digilent inc., Nexys4 DDR FPGA Board Reference Manual, Avril 2016
• 128 MiB DDR2
4
FPGA: trois composantes principales

• Un FPGA est composé à la base de :

– un réseau de blocs de logique programmable IOB IOB IOB IOB IOB IOB

(Configurable Logic Block  CLB);

– un réseau d’interconnexions programmables entre
les blocs; et, CLB CLB CLB CLB CLB

– des blocs d’entrée et de sortie avec le monde

extérieur (Input/Output Block – IOB).
• Dans la figure, on a: CLB CLB CLB CLB CLB

– 12 IOBs, 15 CLBs
• Par exemple, le FPGA XC7A100T-1CSG324C a
plutôt:
CLB CLB CLB CLB CLB

– 210 IOBs, 7925 CLBs

IOB IOB IOB IOB IOB IOB

5
FPGA de Xilinx série 7 : bloc de logique programmable

• Un CLB est composé de deux tranches (slices).

• Chaque tranche est reliée au réseau
d’interconnexions.
• Les tranches sont reliées entre elles verticalement.

Xilinx inc., 7 Series FPGAs Configurable Logic Block User Guide (ug474 v. 1.7), Nov. 2014
6
FPGA de Xilinx série 7 :
tranche de type L (SLICEL)

• Une tranche comprend:

– Quatre tables de correspondance (Look-up Table –
LUT) à 6 entrées (A6:A1) et deux sorties O6 et O5,
pouvant réaliser une fonction logique à 6 entrées ou
deux fonctions logiques à 5 entrées.
– Trois multiplexeurs (en gris, verticaux) pour réaliser
des fonctions logiques de 7 ou 8 entrées
– Des portes logiques pour l’addition rapide.
– Huit éléments à mémoire:
• 4 (au centre) sont toujours des bascules
• 4 (à droite) peuvent être des bascules ou loquets.
– Des multiplexeurs programmables (en blanc) pour
router les signaux à l’intérieur de la tranche.
• Il existe aussi des tranches de type M qui peuvent
implémenter de la mémoire et des registres à
décalage.
Xilinx inc., 7 Series FPGAs Configurable Logic Block User Guide (ug474 v. 1.7), Nov. 2014
7
Modèle simplifié d’une tranche
(~ une tranche du Virtex 2 Pro)
G4

• Deux tables de correspondance à 4 entrées: G3 D Q

YQ

Table de
– fonction logique G2
correspondance
G CLK
S0
– mémoire RAM G!
16 X 1

– mémoire ROM Y

– décalage H

• Deux éléments à mémoire, bascule ou loquet. H1 S1

• Des multiplexeurs pour router les signaux. F4

XQ
F3 D Q
Table de
correspondance
F2 F CLK
16 X 1 S2
F1

S3
CLK

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Comment une LUT implémente une fonction logique

Portion of gate-level netlist Contents of 3-input LUT

XOR a b c y
a d 0 0 0 0
| XNOR
b 0 0 1 1
0 1 0 1
| y 0 1 1 0
NOT
e 1 0 0 1
c 1 0 1 0
1 1 0 0
1 1 1 1

Source: Maxfield, © Mentor Graphics, 2004 9

Retour: le problème du vote

A B C D F
Un comité composé de quatre personnes a besoin 0 0 0 0 0
d’un mécanisme de vote secret pour les 0 0 0 1 0
amendements sur la constitution du comité. 0 0 1 0 0

Un amendement est approuvé si au moins 3 0 0 1 1 0

0 1 0 0 0
personnes votent pour.
0 1 0 1 0
Concevoir un circuit logique qui accepte 4 entrées 0 1 1 0 0
représentant les votes. La sortie du circuit doit 0 1 1 1 1
indiquer si l’amendement est accepté. 1 0 0 0 0
1 0 0 1 0
1 0 1 0 0
1 0 1 1 1
1 1 0 0 0
1 1 0 1 1
1 1 1 0 1
1 1 1 1 1
FPGA: exemple – implémentation d’une fonction logique

Programmer la tranche du FPGA pour implémenter le A G4

YQ
circuit du problème du vote. B G3
Table de
D Q

correspondance
Étapes: G2
C G
16 X 1 S0
CLK

1. Choisir les ports d’entrée et de sortie. G!

D Y F
2. Indiquer quelles connexions établir.
H
3. Donner le contenu des tables de H1 S1
correspondances. (Ici: la table de correspondance
contient la table de vérité désirée). F4
XQ
F3 D Q
Table de
correspondance
Observations: F2 F
16 X 1 S2
CLK

• La minimisation des équations n’est pas toujours utile. F1

• L’ordre dans lequel on place les entrées est crucial. X

• Des fonctions à plus de 4 entrées nécessiterait plus d’un

niveau de logique. S3
CLK

11
FPGA: composantes secondaires

• Les 3 composantes principales d’un FPGA sont:

– les blocs de logique programmable (CLB/tranches);
– le réseau d’interconnexions; et,
– les blocs d’entrée et de sortie (IOB).
• Parmi les composantes secondaires on retrouve:
1. Des blocs de mémoire intégrée
2. Des fonctions arithmétiques avancées
3. Des modules de génération d’horloge
4. Des réseaux de distribution d’horloges
5. Des microprocesseurs fixes

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1. Blocs de mémoire intégrée

• De plus en plus de transistors … les manufacturiers Columns of embedded

ajoutent de la mémoire. RAM blocks

Arrays of
• Avantage: mémoire accessible directement à programmable
l’intérieur de la puce. logic blocks

• Colonnes de blocs de mémoire intégrées à travers

les CLBs.
• Par exemple, le FPGA XC5VLX50T contient:
– 60 blocs de 36 Kb = 2160 Kb

Source: Maxfield, © Mentor Graphics, 2004 13

2. Fonctions arithmétiques avancées

• Les FPGA ont prouvé leur utilité dans les RAM blocks
applications de traitement de signal. Multipliers
• La multiplication est une opération fondamentale Logic blocks
dans ces applications.
• Les manufacturiers de FPGAs ont donc rajouté des
multiplicateurs dédiés.
• Par exemple, le FPGA XC5VLX50T contient:
– 48 tranches DSP48E avec multiplicateurs de 25 × 18
bits signés

Source: Maxfield, © Mentor Graphics, 2004 14

3. Génération d’horloge

• La génération et la distribution du signal d’horloge

est un problème difficile.
• Un circuit peut nécessiter une dizaine d’horloges
de fréquences différentes.
• Le générateur accepte en entrée une horloge
externe et génère une ou plusieurs horloges Clock signal from
outside world Daughter clocks
internes. used to drive
Clock
internal clock trees
Manager
or output pins
etc.

Special clock
pin and pad

Source: Maxfield, © Mentor Graphics, 2004 15

4. Distribution d’horloge

• Pour distribuer l’horloge à travers la puce tout en

minimisant le déphasage d’horloge, on utilise un
réseau en arbre dédié.
• Ce réseau est alimenté soit par une patte spéciale Clock
Flip-flops
tree
du FPGA à laquelle est associé un amplificateur
dédié, ou bien par l’entremise de signaux internes
pouvant être routés au même amplificateur.

Special clock
pin and pad

Clock signal from

outside world

Source: Maxfield, © Mentor Graphics, 2004 16

5. Microprocesseurs fixes

• Plusieurs FPGA intègrent des microprocesseurs

fixes, ex. PowerPC.
• N’utilisent pas de CLB ni de mémoire du FPGA.
• Architecture résultante très performante, SoC-sur-

Xilinx, Virtex-II Pro and Virtex-II Pro X Platform FPGAs: Complete Data Sheet, Nov. 2007.
FPGA.
• Accès rapide entre le microprocesseur fixe et le
reste de la logique, les multiplicateurs et la
mémoire.

Un ou deux PPC dans la série XC5VFX.

17
Systèmes sur puces avec tissu programmable

• Une tendance plus récente est d’intégrer de la

logique programmable à un microprocesseur.
• Architecture résultante très performante de
System-on-Chip (SoC).
• Accès rapide entre le microprocesseur fixe et le
reste de la logique.
• Exemple: Xilinx – famille Zynq-7000

18
Xilinx inc. « Zynq-7000 A Generation ahead backgrounder », 2013.
Technologie de programmation pour FPGA

• La technologie SRAM est de loin la plus populaire

pour les FPGAs.
• Une cellule de mémoire SRAM comporte 4 ou 6
transistors.
• L’information est perdue quand l’alimentation est
coupée.
• Le fichier de configuration doit être entreposé
dans une mémoire ROM sur la planchette.
• La technologie SRAM est affectée par les
radiations, donc elle n’est pas appropriée pour les
applications spatiales.

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Vous devriez maintenant être capable de …

• Décrire, à l'aide d'un diagramme, la structure interne

d'un FPGA et de ses composantes principales, et
expliquer leur fonctionnement et comment les utiliser.
(B2)
• Décrire, à l'aide d'un diagramme, la structure interne
d'un bloc de logique programmable d'un FPGA, et
expliquer son fonctionnement et comment l'utiliser. (B2)
• Énumérer et décrire les composantes secondaires qu'on
retrouve dans un FPGA. (B2)
• Montrer comment programmer un FPGA pour réaliser
un circuit combinatoire ou séquentiel. (B3)
Code Niveau (http://fr.wikipedia.org/wiki/Taxonomie_de_Bloom)
B1 Connaissance - mémoriser de l’information.
B2 Compréhension – interpréter l’information.
B3 Application – confronter les connaissances à des cas pratiques simples.
B4 Analyse – décomposer un problème, cas pratiques plus complexes.
B5 Synthèse – expression personnelle, cas pratiques plus complexes.
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